改善電磁幹擾有妙招,傾心的往這看!
發布時間:2015-02-06 責任編輯:sherryyu
【導讀】可以說開關電源一直陪伴著我們的生活,由於其有著體積小、功率因數較大等優點,在通信、控製、計ji算suan機ji等deng領ling域yu應ying用yong廣guang泛fan。但dan由you於yu會hui產chan生sheng電dian磁ci幹gan擾rao,其qi進jin一yi步bu的de應ying用yong受shou到dao一yi定ding程cheng度du上shang的de限xian製zhi。本ben文wen將jiang分fen析xi開kai關guan電dian源yuan電dian磁ci幹gan擾rao的de各ge種zhong產chan生sheng機ji理li,並bing在zai其qi基ji礎chu之zhi上shang,提ti出chu開kai關guan電dian源yuan的de電dian磁ci兼jian容rong設she計ji方fang法fa。
開關電源的電磁幹擾分析
開關電源的結構如圖1所示。首先將工頻交流整流為直流,再逆變為高頻,最後再經整流濾波電路輸出,得到穩定的直流電壓。電路設計及布局不合理、機械振動、接地不良等都會形成內部電磁幹擾。同時,變壓器的漏感和輸出二極管的反向恢複電流造成的尖峰,也是潛在的強幹擾源。

圖1 AC/DC開關電源基本框圖
一 內部幹擾源
● 開關電路
開關電路主要由開關管和高頻變壓器組成。開關管及其散熱片與外殼和電源內部的引線間存在分布電容,它產生的du/dt具ju有you較jiao大da幅fu度du的de脈mai衝chong,頻pin帶dai較jiao寬kuan且qie諧xie波bo豐feng富fu。開kai關guan管guan負fu載zai為wei高gao頻pin變bian壓ya器qi初chu級ji線xian圈quan,是shi感gan性xing負fu載zai。當dang原yuan來lai導dao通tong的de開kai關guan管guan關guan斷duan時shi,高gao頻pin變bian壓ya器qi的de漏lou感gan產chan生sheng了le反fan電dian勢shiE=-Ldi/dt,其值與集電極的電流變化率成正比,與漏感成正比,迭加在關斷電壓上,形成關斷電壓尖峰,從而形成傳導幹擾。
● 整流電路的整流二極管
輸shu出chu整zheng流liu二er極ji管guan截jie止zhi時shi有you一yi個ge反fan向xiang電dian流liu,其qi恢hui複fu到dao零ling點dian的de時shi間jian與yu結jie電dian容rong等deng因yin素su有you關guan。它ta會hui在zai變bian壓ya器qi漏lou感gan和he其qi他ta分fen布bu參can數shu的de影ying響xiang下xia產chan生sheng很hen大da的de電dian流liu變bian化huadi/dt,產生較強的高頻幹擾,頻率可達幾十兆赫茲。
● 雜散參數
由(you)於(yu)工(gong)作(zuo)在(zai)較(jiao)高(gao)頻(pin)率(lv),開(kai)關(guan)電(dian)源(yuan)中(zhong)的(de)低(di)頻(pin)元(yuan)器(qi)件(jian)特(te)性(xing)會(hui)發(fa)生(sheng)變(bian)化(hua),由(you)此(ci)產(chan)生(sheng)噪(zao)聲(sheng)。在(zai)高(gao)頻(pin)時(shi),雜(za)散(san)參(can)數(shu)對(dui)耦(ou)合(he)通(tong)道(dao)的(de)特(te)性(xing)影(ying)響(xiang)很(hen)大(da),而(er)分(fen)布(bu)電(dian)容(rong)成(cheng)為(wei)電(dian)磁(ci)幹(gan)擾(rao)的(de)通(tong)道(dao)。
二 外部幹擾源
外部幹擾源可以分為電源幹擾和雷電幹擾,而電源幹擾以“共模”和“差模”方fang式shi存cun在zai。同tong時shi,由you於yu交jiao流liu電dian網wang直zhi接jie連lian到dao整zheng流liu橋qiao和he濾lv波bo電dian路lu上shang,在zai半ban個ge周zhou期qi內nei,隻zhi有you輸shu入ru電dian壓ya的de峰feng值zhi時shi間jian才cai有you輸shu入ru電dian流liu,導dao致zhi電dian源yuan的de輸shu入ru功gong率lv因yin數shu很hen低di(大約為0.6)。而且,該電流含有大量電流諧波分量,會對電網產生諧波“汙染”。
開關電源的EMC設計
產生電磁幹擾有3個必要條件:幹擾源、傳輸介質、敏感設備,EMC設計的目的就是破壞這3個條件中的一個。針對於此,主要采取的方法有:電路措施、EMI濾波、屏蔽、印製電路板抗幹擾設計等。
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1 降低開關損耗和開關噪聲的軟開關技術
軟開關是在硬開關基礎上發展起來的一種基於諧振技術或利用控製技術實現的在零電壓/電流狀態下的先進開關技術。
軟開關的實現方法是:在原電路中增加小電感、電容等諧振元件,在開關過程前後引入諧振,消除電壓、電流的重疊。圖2給出了一種使用軟開關技術的基本開關單元。

圖2 降壓斬波器中的基本開關單元
2 減小幹擾源幹擾能量的緩衝電路
在開關控製電源的輸入部分加入緩衝電路(見圖3),其由線性阻抗穩定網絡組成,用於消除電力線幹擾、電快速瞬變、電湧、電壓高低變化和電力線諧波等潛在的幹擾。緩衝電路器件參數為D1為MUR460,R1=500Ω,C=6nF,L=36mH,R=150Ω。

圖3 緩衝電路
3 切斷幹擾噪聲傳播路徑的EMI濾波
在開關電源輸入和輸出電路中加裝EMI濾波器,是抑製傳導發射的一個很有效方法。其參數主要有:放電電阻、插入損耗、Cx電容、Cy電容和電感值。其中,插入損耗是濾波器性能的一個關鍵參數。在考慮機械性能、環境、成本等前提下,應該盡量使插入損耗大一些。用共模、差模幹擾的測量結果與標準限值,加上適當的裕量可得到濾波器的插入損耗IL。
圖4是220V/50Hz交流輸入的開關電源交流側EMI濾波器的電路。Cy=3300PF,L1、L2=0.7mH,它們構成共模濾波電路,抑製0.5~30MHz的共模幹擾信號。Cx=0.1μF,L3、L4=200~500μH,采用金屬粉壓磁芯,與L1/L2、Cx構成L-N端口間低通濾波器,用於抑製電源線上存在的0.15~0.5MHz差模幹擾信號。R用於消除可能在濾波器中出現的靜電積累。

圖4 開關電源交流側EMI濾波器電路
圖5是開關電源的直流輸出側濾波電路,它由共模扼流圈L1、L2,扼流圈L3和電容C1、C2組成。為了防止磁芯在較大的磁場強度下飽和而使扼流圈失去作用,磁芯必須采用高頻特性好且飽和磁場強度大的恒μ磁芯。

圖5 支流側濾波電路
4 用屏蔽來抑製輻射及感應幹擾
開關電源幹擾頻譜集中在30MHz以下的頻段,直徑r<λ/2π,主要是近場性質的電磁場,且屬低阻抗場。可用導電良好的材料對電場屏蔽,而用導磁率高的材料對磁場屏蔽。此外,還要對變壓器、電感器、功(gong)率(lv)器(qi)件(jian)等(deng)采(cai)取(qu)有(you)效(xiao)的(de)屏(ping)蔽(bi)措(cuo)施(shi)。屏(ping)蔽(bi)外(wai)殼(ke)上(shang)的(de)通(tong)風(feng)孔(kong)最(zui)好(hao)為(wei)圓(yuan)形(xing),在(zai)滿(man)足(zu)通(tong)風(feng)的(de)條(tiao)件(jian)下(xia),孔(kong)的(de)數(shu)量(liang)可(ke)以(yi)多(duo),每(mei)個(ge)孔(kong)的(de)尺(chi)寸(cun)要(yao)盡(jin)可(ke)能(neng)小(xiao)。接(jie)縫(feng)處(chu)要(yao)焊(han)接(jie),以(yi)保(bao)證(zheng)電(dian)磁(ci)的(de)連(lian)續(xu)性(xing)。屏(ping)蔽(bi)外(wai)殼(ke)的(de)引(yin)入(ru)、引出線處要采取濾波措施。對於電場屏蔽,屏蔽外殼一定要接地。對於磁場屏蔽,屏蔽外殼不需接地。
5 合理的PCB布局及布線
一yi般ban來lai說shuo敏min感gan線xian路lu主zhu要yao是shi指zhi控kong製zhi電dian路lu和he直zhi接jie與yu幹gan擾rao測ce量liang設she備bei相xiang連lian的de線xian路lu。要yao降jiang低di幹gan擾rao水shui平ping,最zui簡jian單dan的de方fang法fa就jiu是shi增zeng大da幹gan擾rao源yuan與yu敏min感gan線xian路lu的de間jian距ju。但dan由you於yu受shou電dian源yuan尺chi寸cun的de限xian製zhi,單dan純chun的de增zeng大da間jian距ju並bing非fei解jie決jue問wen題ti的de最zui佳jia途tu徑jing,更geng為wei合he理li的de方fang法fa是shi根gen據ju幹gan擾rao電dian場chang的de分fen布bu情qing況kuang將jiang敏min感gan線xian路lu放fang在zai幹gan擾rao較jiao弱ruo的de地di方fang。PCB抗幹擾布局設計流程如圖6所示。

圖6 PCB抗幹擾布局設計流程
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