揭秘半導體製造全流程(中篇)
發布時間:2021-08-05 來源:泛林半導體設備技術 責任編輯:wenwei
【導讀】在上次的推文《泛林小課堂 | 半導體製造八大步驟(上篇)》中,我們給大家介紹了晶圓加工、氧化和光刻三大步驟。本期,我們將繼續探索半導體製造過程中的兩大關鍵步驟:刻蝕和薄膜沉積。
第四步 · 刻蝕
在晶圓上完成電路圖的光刻後,就要用刻蝕工藝來去除任何多餘的氧化膜且隻留下半導體電路圖。要做到這一點需要利用液體、氣體或等離子體來去除選定的多餘部分。
刻蝕的方法主要分為兩種,取決於所使用的物質:使用特定的化學溶液進行化學反應來去除氧化膜的濕法刻蝕,以及使用氣體或等離子體的幹法刻蝕。
濕法刻蝕

使用化學溶液去除氧化膜的濕法刻蝕具有成本低、刻蝕速度快和生產率高的優勢。然而,濕法刻蝕具有各向同性的特點,即其速度在任何方向上都是相同的。這會導致掩膜(或敏感膜)與刻蝕後的氧化膜不能完全對齊,因此很難處理非常精細的電路圖。
幹法刻蝕
幹法刻蝕可分為三種不同類型。第一種為化學刻蝕,其使用的是刻蝕氣體(主要是氟化氫)。和濕法刻蝕一樣,這種方法也是各向同性的,這意味著它也不適合用於精細的刻蝕。
第(di)二(er)種(zhong)方(fang)法(fa)是(shi)物(wu)理(li)濺(jian)射(she),即(ji)用(yong)等(deng)離(li)子(zi)體(ti)中(zhong)的(de)離(li)子(zi)來(lai)撞(zhuang)擊(ji)並(bing)去(qu)除(chu)多(duo)餘(yu)的(de)氧(yang)化(hua)層(ceng)。作(zuo)為(wei)一(yi)種(zhong)各(ge)向(xiang)異(yi)性(xing)的(de)刻(ke)蝕(shi)方(fang)法(fa),濺(jian)射(she)刻(ke)蝕(shi)在(zai)水(shui)平(ping)和(he)垂(chui)直(zhi)方(fang)向(xiang)的(de)刻(ke)蝕(shi)速(su)度(du)是(shi)不(bu)同(tong)的(de),因(yin)此(ci)它(ta)的(de)精(jing)細(xi)度(du)也(ye)要(yao)超(chao)過(guo)化(hua)學(xue)刻(ke)蝕(shi)。但(dan)這(zhe)種(zhong)方(fang)法(fa)的(de)缺(que)點(dian)是(shi)刻(ke)蝕(shi)速(su)度(du)較(jiao)慢(man),因(yin)為(wei)它(ta)完(wan)全(quan)依(yi)賴(lai)於(yu)離(li)子(zi)碰(peng)撞(zhuang)引(yin)起(qi)的(de)物(wu)理(li)反(fan)應(ying)。

最後的第三種方法就是反應離子刻蝕(RIE)。RIE結(jie)合(he)了(le)前(qian)兩(liang)種(zhong)方(fang)法(fa),即(ji)在(zai)利(li)用(yong)等(deng)離(li)子(zi)體(ti)進(jin)行(xing)電(dian)離(li)物(wu)理(li)刻(ke)蝕(shi)的(de)同(tong)時(shi),借(jie)助(zhu)等(deng)離(li)子(zi)體(ti)活(huo)化(hua)後(hou)產(chan)生(sheng)的(de)自(zi)由(you)基(ji)進(jin)行(xing)化(hua)學(xue)刻(ke)蝕(shi)。除(chu)了(le)刻(ke)蝕(shi)速(su)度(du)超(chao)過(guo)前(qian)兩(liang)種(zhong)方(fang)法(fa)以(yi)外(wai),RIE可以利用離子各向異性的特性,實現高精細度圖案的刻蝕。

如ru今jin幹gan法fa刻ke蝕shi已yi經jing被bei廣guang泛fan使shi用yong,以yi提ti高gao精jing細xi半ban導dao體ti電dian路lu的de良liang率lv。保bao持chi全quan晶jing圓yuan刻ke蝕shi的de均jun勻yun性xing並bing提ti高gao刻ke蝕shi速su度du至zhi關guan重zhong要yao,當dang今jin最zui先xian進jin的de幹gan法fa刻ke蝕shi設she備bei正zheng在zai以yi更geng高gao的de性xing能neng,支zhi持chi最zui為wei先xian進jin的de邏luo輯ji和he存cun儲chu芯xin片pian的de生sheng產chan。
針對不同的刻蝕應用,泛林集團提供多個刻蝕產品係列,包括用於深矽刻蝕的DSiE™係列和Syndion®係列、關鍵介電刻蝕產品Flex®係列、用於導體刻蝕的Kiyo®係列、用於金屬刻蝕的Versys® Metal係列。在行業領先的Kiyo和Flex工藝模塊的基礎上,泛林集團還於去年3月推出Sense.i®係列,其高性能表現能夠滿足前述生產過程所需的精確性和一致性要求,適合各種關鍵和半關鍵性刻蝕應用。
第五步 · 薄膜沉積
weilechuangjianxinpianneibudeweixingqijian,womenxuyaobuduandichenjiyicengcengdebomobingtongguokeshiquchudiaoqizhongduoyudebufen,lingwaihaiyaotianjiayixiecailiaojiangbutongdeqijianfenlikailai。meigejingtiguanhuocunchudanyuanjiushitongguoshangshuguochengyibubugoujianqilaide。womenzhelisuoshuode“薄膜”是指厚度小於1微米(μm,百萬分之一米)、無法通過普通機械加工方法製造出來的“膜”。將包含所需分子或原子單元的薄膜放到晶圓上的過程就是“沉積”。

要形成多層的半導體結構,我們需要先製造器件疊層,即在晶圓表麵交替堆疊多層薄金屬(導電)膜和介電(絕緣)膜,之後再通過重複刻蝕工藝去除多餘部分並形成三維結構。可用於沉積過程的技術包括化學氣相沉積 (CVD)、原子層沉積 (ALD) 和物理氣相沉積 (PVD),采用這些技術的方法又可以分為幹法和濕法沉積兩種。
01 化學氣相沉積

在化學氣相沉積中,前驅氣體會在反應腔發生化學反應並生成附著在晶圓表麵的薄膜以及被抽出腔室的副產物。
denglizitizengqianghuaxueqixiangchenjizexuyaojiezhudenglizitichanshengfanyingqiti。zhezhongfangfajiangdilefanyingwendu,yincifeichangshiheduiwendumingandejiegou。shiyongdenglizitihaikeyijianshaochenjicishu,wangwangkeyidailaigenggaozhiliangdebomo。
02 原子層沉積

yuanzicengchenjitongguomeicizhichenjijigeyuanzicengcongerxingchengbomo。gaifangfadeguanjianzaiyuxunhuananyidingshunxujinxingdedulibuzhoubingbaochilianghaodekongzhi。zaijingyuanbiaomiantufuqianqutishidiyibu,zhihouyinrubutongdeqitiyuqianqutifanyingjikezaijingyuanbiaomianxingchengsuoxudewuzhi。
03 物理氣相沉積

顧gu名ming思si義yi,物wu理li氣qi相xiang沉chen積ji是shi指zhi通tong過guo物wu理li手shou段duan形xing成cheng薄bo膜mo。濺jian射she就jiu是shi一yi種zhong物wu理li氣qi相xiang沉chen積ji方fang法fa,其qi原yuan理li是shi通tong過guo氬ya等deng離li子zi體ti的de轟hong擊ji讓rang靶ba材cai的de原yuan子zi濺jian射she出chu來lai並bing沉chen積ji在zai晶jing圓yuan表biao麵mian形xing成cheng薄bo膜mo。
在某些情況下,可以通過紫外線熱處理 (UVTP) 等技術對沉積膜進行處理並改善其性能。
泛林集團的沉積設備均具備出色的精度、性能和靈活性,包括適用於鎢金屬化工藝的ALTUS®係列、具有後薄膜沉積處理能力的SOLA®係列、高密度等離子體化學氣相沉積SPEED®係列、采用先進ALD技術的Striker®係列以及VECTOR® PECVD係列等。
下一期,我們將為大家介紹半導體製造中的最後三個重要步驟——互連、測試和封裝,敬請期待!
來源:泛林半導體設備技術
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