Silicon Labs推出簡化相幹光線卡,降低係統成本和複雜度
發布時間:2016-04-26 責任編輯:susan
【導讀】日前,Silicon Labs(芯科科技有限公司)推出一係列簡化100G/400G相幹光線卡(Coherent Optical Line Card)和模塊設計的抖動衰減時鍾,通過提供高頻率、靈活的時鍾解決方案,顯著降低係統成本和複雜度。
Silicon Labs新型Si534xH相幹光時鍾可以為數據轉換器提供低抖動參考定時,可替代依賴於昂貴、大封裝尺寸的壓控SAW振蕩器(VCSO)的分立定時解決方案。與僅支持單一固定頻率的VCSO不同,新型Si534xH時鍾提供很寬的頻率範圍,支持頻率高達2.7GHz,且無需改變物料清單(BOM)元器件。

Si5344H和Si5342H時鍾提供最佳的頻率靈活性和無與倫比的50fs RMS抖動性能。這些時鍾芯片簡化了器件采購過程,可采用交貨時間短至兩周的單個時鍾IC解決方案,來替代多個需定製的、較長交貨時間的VCSO。憑借抖動衰減PLL、高頻率輸出驅動器、分數頻率合成和數字控製振蕩器(DCO)技術,Si534xH係列產品為相幹光收發器應用提供所需的全部時鍾功能,與競爭對手解決方案相比降低了40%的占用麵積及40%的功耗。

通信市場中最大增長驅動因素之一是業內城域網絡和數據中心互聯(DCI)領域從10G到100G的轉變。相幹光學技術可用於100G和400G應ying用yong,因yin為wei它ta使shi得de服fu務wu提ti供gong商shang能neng夠gou通tong過guo現xian有you的de光guang纖xian發fa送song更geng多duo的de數shu據ju,減jian少shao為wei帶dai寬kuan擴kuo展zhan而er進jin行xing網wang絡luo升sheng級ji的de成cheng本ben和he複fu雜za性xing。當dang前qian用yong於yu相xiang幹gan光guang的de定ding時shi解jie決jue方fang案an在zai成cheng本ben和he尺chi寸cun方fang麵mian還hai未wei達da到dao最zui優you化hua,需xu要yaoVCSO、時鍾發生器和分立器件的多樣化組合。
Silicon Labs的Si534xH時鍾是專門用於滿足100G/400G相幹光應用對於定時的要求。除了支持光收發數據轉換器中定時所需的超高頻合成,Si534xH時鍾還整合了Silicon Labs經過市場驗證的DSPLL®抖動衰減技術和MultiSynth低抖動分數頻率合成技術,從而提供了巧妙的、易於使用的單芯片解決方案。所有100G/400G發射器或接收器時鍾都可以由單個芯片生成,通過消除大量分立器件,將BOM成本降至最低並降低了複雜度。

Silicon Labs定時產品高級營銷總監James Wilson表示:“為了滿足日益增加的帶寬需求,運營商需要100G/400G相幹設計,從而獲得比傳統方案更高的線卡端口密度和更低的位成本。Silicon Labs的Si534xH時鍾產品與傳統基於VCSO的解決方案相比,具有顯著減小的占用麵積和更低的功耗等優勢,它能夠為相幹光應用提供所需的高頻率時鍾合成、抖動衰減和嚴格的相位噪聲。”
Silicon Labs的ClockBuilderProTM支持相幹時鍾開發,它是一款能夠簡化時鍾樹設計、設備配置和評估細節性能的易用型軟件工具。該工具能夠獨立生成芯片配置文件或者直接控製評估板上的Si534xH芯片。ClockBuilder Pro也能夠用於創建Silicon Labs抖動衰減器和時鍾發生器的工廠定製版本,從而滿足每個客戶獨特的計時要求。

Si534xH相幹光時鍾產品特性:
用於發射器和接收器時鍾的超高性能抖動衰減PLL;
用於最大2.7GHz數據轉換器時鍾的高速驅動器,且具有超低相位噪聲;
典型50fs RMS(1MHz至40MHz)抖動性能;
MultiSynth分數頻率合成,可生成最大712.5MHz的任意頻率;
集成環路濾波器和用戶可編程PLL帶寬,實現靈活的抖動衰減;
高速、數字可調的DCO模式:0.001ppb分辨率,1MHz SPI更新速率;
適合模組化的尺寸和功耗;
簡單易用的ClockBuilder Pro軟件;
價格及供貨:
Si5344H和Si5342H相幹光時鍾樣片現已供貨,采用7mm×7mm 44QFN封裝,計劃於5月量產。當采購量在一萬片時的單價為27美元起。標準和定製的芯片可在短期內交貨(樣片需兩周時間,量產訂單需四周時間),這簡化了原型設計和量產階段的采購。為了簡化芯片評估和係統級定時設計,Silicon Labs還提供Si5344H-EVB和Si5342H-EVB評估板,價格均為199美元。
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